Preguntas con etiqueta 'verilog'

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Modificar el código CORDIC verilog para -360 a 360 grados

Estoy aprendiendo sobre CORDIC y lo estoy implementando en Verilog. Encontré este ejemplo que puede calcular el pecado y el cos para los ángulos en el primer cuadrante (0-90). enlace ¿Cómo modificaría este código para calcular sin y cos par...
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Mezcla reiniciar y no reiniciar registros

Si debe mezclar fracasos de reinicio síncrono y no reinicio en un solo bloque siempre, esta sería la forma correcta ... always @ (posedge clk) if ( reset ) begin resettable_flops <= 0; // Resettable to 0. nonresettable_flops &l...
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Inicialización de Hitatchi LCD

Intentando configurar la inicialización del HD44780. ¿Es esta mala práctica haberlo hecho así? ¿O va a intentar enviar todas esas líneas a LCD_DATA a la vez? enter code here always LCD_RW = 1'b0; initial begin LCD_RS <= 1'b0; #15; //dela...
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¿Qué pasa con mi multiplexor Verilog?

Creé un multiplexor de 2 bits de 2 vías: module mux2(c, x, y, m); input c; input [3:0] x; input [3:0] y; output [9:0] m; assign m[3:0] = (~c & x) | (c & y); assign m[9:4] = 0; endmodule Lo instalé desde mi módulo de niv...
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Asigment Verilog y replicación, ¿Qué hace el paréntesis?

Estoy tratando de entender el siguiente ejemplo de código de Verilog, hasta ahora puedo decir que si address == 0 entonces realice el & con data_in o si es 1 realiza bit -wise & con data_dir . Lo que...
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código Verilog para el divisor de frecuencia

¿Puede ayudarme, por favor, a crear un código Verilog para el circuito divisor de frecuencia que pueda generar una señal de reloj 50Hz fuera de la señal 50MHz utilizando 16 bits contador síncrono. He intentado hacerlo, ¡pero no funcionó!...
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¿Existe alguna herramienta que pueda crear un circuito lógico equivalente a algún código de Verilog?

Con el propósito de aprender, me gustaría saber si hay alguna herramienta (gratuita o comercial) que pueda sintetizar algún código de Verilog y producir el circuito lógico equivalente. Ejemplo: assign z = (a & b) | c; No me in...
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Necesita ayuda para ordenar una cadena de 32 bits

Tengo que programar un circuito combinado que ordena una matriz de 32 bits como esta: 10011011010101010101010101010110010 == > 00000000000000011111111111111111 La entrada debe ser paralela y de 32 bits. La salida debe ser serial y 32 tacts...
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Active low vs active High reset en CPLD

Estoy usando el CPLD de la serie CoolRunner-II de Xilinx y programando la lógica programable por primera vez. Tengo que usar algunos de los flip-flops con reinicio asíncrono. Me pregunto cuál es la diferencia entre un restablecimiento acti...
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Problema del oscilador en anillo Verilog

Estoy tratando de hacer un oscilador de anillo dentro de un CPLD CoolRunner-II de Xilinx y estoy tratando de medir cuántos ciclos de oscilador de anillo caben dentro de la mitad baja del reloj externo de 10MHz. A continuación se muestra el códig...