Preguntas con etiqueta 'vhdl'

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contador simple en VHDL

Estoy tratando de escribir un pequeño contador en VHDL usando la metodología de los dos procesos. Sin embargo no está funcionando. ¿Podría alguien explicarme por qué? library IEEE; use IEEE.std_logic_1164.all; use IEEE.std_logic_arith...
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Altera Quartus Design Assistant Advertencias críticas

Recibo varias advertencias críticas con respecto a lpm_ff y lpm_counter: A continuación hay algunos: Regla A102: la salida del registro no debe controlar su propia señal de control directamente oa través de la lógica combinacional - Estruc...
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Dos declaraciones de proceso VHDL que leen la misma señal y una la modifican

Digamos que tenemos dos declaraciones de proceso en VHDL que reaccionan en el mismo borde del reloj. Al lado del reloj también tenemos, por ejemplo, la señal de reinicio. Sé que solo un proceso puede modificar la señal de restablecimiento, de...
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Código VHDL para 4x4 Mult: SYNTAX OK BUT ERROR: HDLCompiler: 1029

Hola, esta es mi primera publicación aquí, tengo un código que escribí con el que tengo problemas. Esperaba poder conseguir ayuda. Tengo algunos problemas con mi código VHDL para un multiplicador 4x4. El esquema que estoy usando es el sigu...
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Casos de prueba para un banco de pruebas de calculadora en VHDL

Acabo de anotar un núcleo de calculadora con VHDL que realmente hace una multiplicación, suma, una operación Xor y una operación AND y tengo que escribir un banco de pruebas que debería simular las cuatro funciones para todas las combinaciones p...
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Beneficio de usar RAM, o alguna forma de memoria interna en un FPGA

En este momento estoy tratando de almacenar una imagen en un FPGA. Calculé que el espacio requerido para él era de 19200 kb, y por eso me pregunto si debería almacenarlo de otra forma que no sea una matriz 2D. ¿O el programa que creo automáticam...
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¿Cómo asignar una entrada a un conmutador? [cerrado]

Actualmente estoy trabajando en un sumador de 8 bits que crea una instancia de un sumador completo. Tengo que asignar 17 interruptores como entradas a, b y Cin. ¿Cómo puedo hacer eso?     
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Aplicación de búfer de rendimiento Boost [Xillybus - VHDL]

En esta pregunta anterior link He desarrollado una aplicación que secuencialmente lo hizo: obtenga y almacene 8 valores de entrada (8 caracteres) alternar entre mayúsculas y minúsculas (o viceversa) solo el primer carácter saca los och...
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swapping VHDL FPGA [cerrado]

Quiero desarrollar una aplicación que pueda obtener y almacenar dos valores de entrada, cambiar de minúsculas a mayúsculas solo la primera Valor y finalmente salir los dos valores almacenados. Por ejemplo: si la entrada la cadena es "john", ento...
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Cómo convertir datos antes de enviarlos a FIFO [Xillybus - VHDL]

Conecté mi propio FIFO a xillydemo. Más precisamente, xillydemo recibe algunos datos, tiene que convertir los datos y enviar los datos a FIFO. a su vez, el FIFO debe enviar datos a xillydemo. Lo que quiero hacer es convertir (en xillydemo.vhd...