Preguntas con etiqueta 'verilog'

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Problema con 8-bit Carry Lookahead Adder en Verilog

SoynuevoenlaprogramacióndeVerilog.EstoytratandodetrabajarconunCLAde64bitsmediantelacreacióndeunCLAde4bits,luegode8bits(de2instanciasde4bits),luegode16bits(de2instanciasdeUnode8bits).Proporcionarémicódigo,luegounaexplicacióndelproblemaqueestoyte...
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¿Cuál será la síntesis de este pequeño fragmento de Verilog?

always_comb begin for (index = 0; index < NUM_REQUESTORS; index++ ) begin if (valid[index]) begin grant = index; break ; end end end Mi conjetura es que sintetizará en una cadena...
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valor de la variable en Veriog no definido

Estoy analizando un archivo verilog para siempre. en esto, ¿cuál debería ser el valor de "en" en caso de que primero y luego en segundo? always @(in1, in2, en) begin out = in2; if(en) begin out = in1; donde in1, in2 y e...
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Verilog interactuando con C #

En este momento, estoy tomando un curso sobre Verilog HDL, sin embargo, nuestro instructor nos dio un problema con la máquina en el que estamos obligados a implementar un programa que use verilog mientras que C # es nuestra principal interfaz gr...
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¿Cuál es el orden de la matriz generada por Verilog? Sintaxis

¿Cuál es la interpretación correcta entre estas dos líneas: cable [2: 0] w = SW [17:15] = {SW [17], SW [16], SW [15]} cable [2: 0] w = SW [17:15] = {SW [15], SW [16], SW [17]} Cuando llame a w [0], ¿obtendré SW [15] o SW [17]? Esto me e...
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Aprender CPLD desde cero [cerrado]

a) ¿Debo aprender VHDL o Verilog? ¿Uno sobresale en alguna área mientras que el otro se ajusta mejor a otra área? Para una "lógica de pegamento" simple, dice, de 5 a 30 chips TTL equivalentes, ¿cuál es mejor? b) El primer ejercicio de apre...
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Buscar raíz cuadrada de un número sin signo de 32 bits [cerrado]

¿Cómo averiguar la raíz cuadrada de un número de punto fijo sin signo de 32 bits en verilog? La entrada es un entero positivo de 32 bits. La salida debe estar representada en formato 16.16 (16 enteros y 16 bits fraccionarios). Estoy usando la pl...
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desplazamiento de bits usando verilog

Estoy usando el lenguaje verilog para mi programa usando ISE 14.5, cuando doy una entrada por ejemplo x = 0.707 y la simulo en un banco de pruebas, me da una salida incorrecta porque considera 0.707 como 1. mi pregunta es cómo manejar el número...
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Sumador completo de 4 bits usando dos sumadores completos de 2 bits

Tengo los módulos para un sumador completo de 1 bit y un sumador completo de 2 bits (construido sobre el sumador de 1 bit). ¿Puedo saber cómo podría escribir el sumador de 4 bits posterior basado en el sumador de 2 bits? Esto puede ser un poco p...
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¿Debería un estudiante de Ciencias de la Computación aprender FPGA [cerrado]

Soy un estudiante de informática, sé que CS tiene más que ver con algoritmos, teoría de la computación, estructuras de datos, inteligencia artificial, etc. Pero creo que el estudiante de CS también debe tener una comprensión básica del diseño de...