¿Puedo usar el pin B25 en el conector PCI de mi placa base como fuente de alimentación o
¿Necesito usar el pin B5 y B6 (5V) del conector PCI en la placa base y regularlo con AM1117 3.3V para mi placa PCI?
Necesito la fuente de alimentación para...
Estoy haciendo un proyecto fpga en vhdl para mis estudios.
Estoy mostrando un perro en la pantalla que intento mover. Eso funciona bien para derecha, izquierda y arriba, pero al tratar de hacer que el perro caiga, se mueve de una manera extra...
Utilizo un archivo VCD para evaluar la potencia de mi diseño. El VCD se genera usando el siguiente comando en el archivo testbench.
$dumpfile ("testb.vcd");
$dumpvars (0, tb.gcm_tb);
tb es el nombre del módulo del banco de pruebas....
En diversas tecnologías (discreta, ASIC, FPGA), me gustaría saber si las señales asíncronas configuradas y reiniciadas están siempre presentes en los flip-flops D (activados por el borde). Si no, ¿cómo se puede manejar el proceso de reinicio?
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Tengo dos módulos
contador: la salida es un vector llamado error_count.
lcd: Módulo para mostrar el código en una pantalla LCD. La entrada incluye clock y error_count.
El siguiente fragmento de código es el más relevante y se adjunta a...
Tengo un FPGA altera stratix iv, que me dio mi profesor para hacer un proyecto que involucra el procesamiento de video.
Los puertos con los que tengo que trabajar son RS232 (hembra), un puerto IDE y varios puertos SATA, y varios puertos Ether...
Necesito información sobre la implementación de un diseño de comunicación digital inalámbrica de alta velocidad (> 100Mbps).
La parte que me preocupa es la entrada de datos al RF PA, tenemos un tipo que trabaja en el proyecto, que es un exper...
He visto la hoja de datos del Cyclone III y afirma que es compatible con DDR y DDR2.
Pero estaba buscando algunos buenos chips LPDDR para mi diseño.
¿Puedo usar el PHY dentro de Cyclone III con LPDDR ic?
¿Conoces otro FPGA compatible con LPDDR?...
Como parte de mi proyecto para el curso de Diseño de sistemas digitales, tengo que usar un componente para mostrar en la pantalla de 7 segmentos un rango INTEGER de 0 a 9999 (o un std_logic_vector (13 downto 0)). Utilicé el algoritmo de dabble d...
Necesito comunicarme desde FPGA a ARM con aproximadamente 16GBits / s ...
¿Hay un autobús que pueda usar? ¿O cómo resolver este problema?
El FPGA recibe datos a través de LVDS. Estos datos se pueden postprocesar en ARM (el usuario puede escri...