Preguntas con etiqueta 'cadence'

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error de restricción de tiempo del compilador RTL

Necesito saber la frecuencia de reloj máxima de mi diseño. Pero el compilador RTL no me da la frecuencia máxima si no doy una restricción de tiempo. (En realidad, no estoy seguro de si me dará la frecuencia si especifico una restricción de tiemp...
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generar padstacks programáticamente para Cadence Allegro

Estoy diseñando un tablero complejo, con muchos componentes. Uno de los pasos es crear padstacks para las huellas de cada componente. Resulta que tengo (casi solo) dos tipos de padstacks para generar: Para los componentes del orificio pasant...
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Modelo de simulación de FGMOS programable usando Virtuoso

Sé que se puede introducir la programabilidad en el transistor FGMOS utilizando el túnel Fowler-Nordheim y la inyección de electrones en caliente, pero no puedo implementar esta idea en la herramienta de diseño de cadencia virtuoso. Me gustaría...
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Restricciones de tiempo para el multiplexor de salida DDR

Considere el siguiente circuito, que multiplexa las entradas d0 y d1 a la salida y en un ciclo de reloj (es decir, doble velocidad de datos, DDR). simular este circuito : esquema creado usando CircuitLab Que pued...
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¿Cómo agregar dos expresiones de salida para calcular la tercera expresión en Cadence icfb 5?

Estoy tratando de calcular el tiempo promedio de propagación carry_TP de carry_TPHL y carry_TPLH, que ya obtuve la expresión de la herramienta de la calculadora y funciona bien. Ahora, ¿cómo hago la tercera expresión de salida para carry_TP = (c...
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PSpice VSIN frecuencia: ¿cómo configurarla en rad / s?

Sé que si quiero establecer FREQ, necesito configurarlo en Hz, no en rad / s. Lo sé, que 1 Hz = 2 * pi rad / s, pero ¿cómo hacer esto en PSpice? ¿Qué debo ingresar exactamente? y por cierto. Si quiero configurar VOFF (offset de voltaje)...
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¿Por qué la transconductancia de MOS no es cero incluso cuando la corriente de drenaje es constante?

Estoy tratando de trazar la transconductancia \ $ g_m \ $ del MOSFET a continuación cuando \ $ V_ {gs} \ $ varía de 0 a 1.8V. El esquema está abajo. La corriente de drenaje se fija en un valor de CC constante 1uA por una fuente de corriente....
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La simulación de PSPICE del voltaje del capacitor y la corriente no está de acuerdo con las matemáticas

Estoy probando un circuito lo suficientemente simple en PSPICE. El zener tiene un BV = 220V, por lo que el capacitor tiene un voltaje de 220V hasta que el interruptor se cierra. Utilizandolaecuacióndetiempoparaelvoltajedeuncapacitor:Vc(t)=Vo*e^...
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Estimación del consumo de energía en el compilador de cadencia RTL con archivo VCD

Necesito analizar el consumo de energía usando el compilador RTL basado en el archivo VCD generado por ModelSim. Tengo dos archivos: gcm.v (Este es el circuito principal. El nombre del módulo es "gcm") tb.v (Este es el banco de pruebas. El...
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Las gráficas de PSPICE funcionan por separado para los subcircuitos, ¿mal cuando se combinan?

Estoy trabajando en un circuito de generación de impulsos que se utilizará para impulsar un transductor ultrasónico. El siguiente circuito está dando una salida inesperada. Puedeparecercomplicado,peroenrealidadsepuededividirenpartesmáspequeñ...