Estoy haciendo mi diseño con Vivado HLs y Vivado y estoy haciendo algunas transferencias algo grandes entre DDR y mi bloqueo de IP personalizado y viceversa.
Cada transferencia de DDR a IP personalizada es de 256x256x4 = 262144 bytes y ocurre...
Estamos utilizando un fpga con recursos limitados, el IGLOO Nano, por lo que para implementar toda nuestra funcionalidad, necesitamos compartir un FIFO entre dos componentes diferentes de vhdl, que utilizan diferentes relojes.
La funcionalidad...
Entonces, después de recibir algunos consejos de algunas buenas personas aquí, logré armar mi primer diseño de FPGA (muy modesto). Básicamente, son solo unos pocos registros y contadores, y solo se ejecutan a unos pocos MHz, pero podría sintetiz...
Estoy viendo un código VHDL y las siguientes líneas están presentes:
type obj_code_t is array(integer range <>) of std_logic_vector(7 downto 0);
y
OBJ_CODE : obj_code_t;
¿Qué significa el <> ?
Tal como lo dice el título, ¿cómo ocurre esto? Estoy tratando de envolver mi cabeza en torno a los procesos frente a los componentes y no entiendo cómo funciona este mecanismo. Puede que esta no sea una pregunta adecuada, así que, por favor, ayú...
Sincronización:
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Port ( ...
rotary_a : in std_logic;
rotary_b : in std_logic;
...);
...
signal rotary_a_in : std_logic;
signal rotary_b_in : std_logic;
signal rotary_in :...
Las herramientas Xilinx dan MUCHAS advertencias sobre cualquier diseño significativo. A veces, reviso mi diseño para eliminar las advertencias (por ejemplo, si un canal de un módulo ADC no se usa, voy a cambiar el módulo para eliminarlo, etc.)....
Estoy diseñando una pequeña placa de desarrollo para la experimentación de FPGA con el Cyclone IV EP4CE10 pero tengo algunos problemas para estimar los requisitos de energía. Entiendo que esto depende casi completamente del uso y la configuració...
Dada una caja negra con N entradas binarias y especificación de la salida para cada uno de los 2 ** N posibles estados de entrada (pero no hay conocimiento previo de la lógica en la caja) Necesito Herramientas de software para diseñar la lógic...