Preguntas con etiqueta 'sram'

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¿Por qué es necesario un eNVM y un eSRAM en el mismo SoC FPGA?

SmartFusion2 SoC FPGA se distingue por contener una memoria no volátil (eNVM) incorporada que se utiliza para almacenar el código necesario para el proceso de arranque del FPGA después del encendido. Entonces, en presencia de esta memoria Flash,...
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Adjuntar dos PSRAM idénticas al mismo conjunto de señales

Tengo un microprocesador ARM conectado a un FPGA a través de un bus de memoria de 47 pines. Además, dos PSRAM idénticos (hoja de datos disponible aquí ) están conectados al FPGA a través de 65 pines (47 para el primer PSRAM + 16 pines de datos...
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SRAM comercial con fuente de alimentación separada para el núcleo y el periférico?

¿Hay SRAM comerciales disponibles con una fuente de alimentación separada para los transistores centrales (6T) y una fuente separada para los circuitos restantes, como los amplificadores de detección, los controladores de escritura, etc.? Cre...
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cómo dibujar el esquema del nivel de transistor en una SRAM de 3 puertos

He estado intentando buscar una celda SRAM de 3 puertos (2 lecturas y 1 escritura) en todas partes, pero no puedo encontrar nada al respecto. ¿Alguien sabe de alguna fuente en la que pueda ver cómo se puede implementar uno mediante puertas lógic...
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Sustitución de CMOS SRAM con TTL SRAM equivalente

Quiero reemplazar un IS62WV51216BLL-55 ( enlace ) por un AS7C4098A-12 ( enlace ), ya que este último tiene una velocidad mucho mejor (aunque menos capacidad, pero eso no es un problema en mi caso), para estar conectado con algunos STM32 que teng...
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4T SRAM operación de lectura y escritura

¿Puede alguien decirme, por favor, cómo funciona una 4AM SRAM (4 transistores MOS + 2 poli resistencia)? ¿Cómo se lleva el nodo interno a un valor alto? ¿Sigue siendo estático o dinámico?     
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AVR: por qué los datos de lectura tienen algo de retraso en escribirlos en SRAM (Diagrama de tiempo)

En ese diagrama de tiempo vemos que el comando de escritura en el mismo tiempo casi con los datos. ¿Por qué no vemos eso también en la lectura de datos y por qué existe ese retraso entre los datos y el comando de lectura? Es la captura de pan...
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Reemplazo para IDT70825S / L: Acceso secuencial / Memoria de acceso aleatorio

Estoy creando un circuito que necesita almacenar de manera secuencial los píxeles de una señal VGA a 25MHz (usando el TVP7002 de TI) en la RAM, y luego debo acceder a los píxeles fuera de orden. Parece que solía haber un chip que permitiría exac...
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VGA doble búfer con bloque de memoria RAM

Estoy planeando una consola de juegos discreta para mi propio ocio, basada en la señal VGA. He implementado partes de la misma en placas con muchos cables, pero es muy propenso a errores, por lo tanto mi traslado al mundo FPGA. Goz : Resol...
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¿Cuál es el orden exacto de ejecución para acceder a la SRAM utilizando un multplexer?

Hola, comunidad de ingenieros eléctricos, Soy nuevo en esta comunidad y, de hecho, nuevo en la electrónica Así que por favor sea amable, gracias, de antemano ... Tengo 2 x chips IC IC SRAM ASC4008 de memoria, Creo que tienen un tamaño de 5...