Preguntas con etiqueta 'memory'

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¿Cómo se calcula la compensación de bytes?

Estoy confundido por el concepto de compensación de bytes. En mi libro de texto, los ejemplos siempre muestran el desplazamiento de bytes alineado con la palabra como dos bits, pero en realidad no explica cómo llegan a ese valor. Dice que están...
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Hashtag al lado de los nombres de los pines [duplicado]

¿Qué significa Hashtag (#) cuando se agrega junto a algunos nombres de pines en hojas de datos ... como WE # en el pinout memeory flash o RI # en hojas de datos RS232 FTDI?     
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¿Cómo se relaciona la interfaz Xilinx MIG AXI con el pinout DDR PHY?

En la parte inferior de la página 156 de UG586 puedo entender cómo se asigna la dirección de usuario a la salida de PIN de PHY. Sin embargo, no puedo entender la página 155 del mismo manual. ¿Cómo se asigna el espacio de direcciones de Microblaz...
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¿Por qué direcciones de bit de bus y bit de bus de datos diferente [cerrado]

Recientemente leí que el bus de direcciones tiene datos / direcciones de 16 y 4 bits en la ROM.     
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Caché asignado directo [duplicado]

Una computadora que usa un caché de mapa directo tiene \ $ 2 ^ {24} \ $ palabras de la memoria principal y un caché de 256 bloques. Cada bloque de caché contiene 64 palabras. ¿Cuántos bloques de memoria principal hay? ¿Cuál es el formato...
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Modos de falla de memoria flash - Bloqueo de falla [cerrado]

Tengo entendido que las fallas típicas de la memoria flash, como las que se deben a los ciclos de borrado, ocurren a nivel de bits. Tengo un flash en el que fallan bloques completos (en realidad dos bloques). ¿Hay una explicación común para esto...
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¿Cuál es el tamaño del átomo de DRAM? ¿Tiene alguna relación con el tamaño del canal?

He visto que el tamaño del canal está en bits (64b / 128b), lo que entiendo es la cantidad de datos que un canal puede transferir en un borde. Pero veo que el tamaño del átomo está en bytes. Entonces, ¿un átomo de transferencia toma múltiples tr...
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¿Términos (banco, latencia) en la memoria principal?

Una CPU tiene un caché con un tamaño de bloque de 64 bytes. La memoria principal tiene k bancos, cada banco tiene c bytes de ancho. C: los segmentos de bytes consecutivos se asignan en bancos consecutivos con resumen. Se puede acceder a todos lo...
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Controle las líneas WR y OE de SRAM paralelas con solo 2 cables mientras carga datos con 8

Este es mi circuito en relación con mi pregunta: Pido disculpas por el desordenado cableado, pero lo hice de esa manera para hacer que la producción de mi PCB sea sustancialmente más fácil. Mi problema es que solo tengo 10 cables dis...
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Memoria de caché al llegar, no hay datos almacenados

Entonces, tengo una pregunta sobre la memoria caché, sé que si la etiqueta coincide con los datos se recuperarán, pero qué sucede si la dirección actual tiene la misma etiqueta con otras personas pero en ese lugar, en mi foto (10 ) donde estaría...