Preguntas con etiqueta 'programmable-logic'

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¿Puedo usar el lenguaje C para programar un CPLD / FPGA?

¿Quería saber si puedo programar CPLD / FPGA con lenguaje C? Si es así, ¿se practica comúnmente? ¿Cuáles son los pasos y los requisitos & ¿Herramientas para el mismo?     
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¿Cómo puedo aumentar la cantidad de UART de hardware en un diseño con un solo UART MCU?

Estoy utilizando una MCU TI CC430 porque contiene una interfaz de radio CC1101 incorporada. Realmente me gustaría seguir con este MCU. Sin embargo, necesito interactuar simultáneamente con una radio serial separada, un FTDI (uart- > USB) y un...
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Explique esta diferencia de precio

Cuando visité a mi proveedor de componentes, detecté un poco de GAL22V10 disponible allí. Pregunté el precio: CNY24 (alrededor de US $ 4) un pop, NOS. Luego pregunté sobre EPM240T100C5 , un CPLD de 100 pines de 240 LU y el precio...
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Herramienta gratuita de linting para Verilog

¿Existe una herramienta de creación de líneas de código abierto para Verilog? He visto a un compañero de HDL y otros, pero todos vienen con una etiqueta de precio.     
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CPLD (a veces) no incrementa el contador

Tengo este programa simple ejecutándose en el Altera EPM240 que a veces no hace el incremento del contador. reg trigger_state; reg [7:0] trigger_count; always @ (posedge clk) begin if (trigger != trigger_state) begin trigger_state &...
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Salidas incorrectas en la entidad VHDL

Tengo una lección sobre VHDL en una de mis clases universitarias y tengo que escribir entity simple que generará reloj desde una fuente de 1MHz. Estoy usando CoolRunner-II CPLD Starter Kit con ISE Webpack 13.1. Cuando ejecuto la simu...
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uC plataformas a considerar para una CPU más rápida y más de 30 pines GPIO

Estoy creando un proyecto Persistence of Vision con 120 leds RGB (= 360 líneas totales para controlar). Nos hemos decidido por el TLC5940 para controlar los LED (y podríamos estar abiertos a cambiar esto), sin embargo, ahora tenemos un Probl...
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FPGA o CPLD para la "lógica de pegamento" y capacidades de video / LCD

Algunos de ustedes recordarán que publiqué una pregunta en la que se sugirió que usara CPLD en lugar de una gran cantidad de multiplexores. Aquí está la pregunta, para referencia. Sin embargo, a medida que leía y aprendía sobre CPLD y FPGA,...
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¿Hay chips FPGA que permitan actualizar la lógica programable desde la lógica misma?

A los fines de la investigación, me interesa si hay chips FPGA que puedan actualizar el bytestream (la lógica programable) desde el mismo bytestream.     
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Verilog - Una línea permanece alta, necesito que se quede baja después de un tiempo

Estoy trabajando en un circuito en Verilog para implementarlo en un CPLD. La salida del circuito impulsará un motor paso a paso. La entrada es un flujo de pulsos de una máquina. Genero un pulso paso a paso cada X pulsos de husillo. No hay pro...