Preguntas con etiqueta 'digital-logic'

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Cambio entre múltiples carriles para medir la resistencia

Por lo tanto, tengo un poco de GPU MXM que tienen algún tipo de problema con la placa u otro, y la medición de cada pin frente a tierra suele ser el segundo paso para intentar reparar. Curiosamente, tengo la idea de medir la resistencia pin por...
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¿Existen conflictos en las definiciones de XNOR? [duplicar]

XNOR tiene dos definiciones: \ $ 1 ^ {st}: XNOR = NOT (XOR) \ $ \ $ 2 ^ {nd}: XNOR (A, B) = \ overline {A} \ cdot \ overline {B} + A \ cdot B \ $ El problema es que estas definiciones no son iguales en las entradas impares, la seg...
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¿Cómo elegir qué función usar dependiendo del valor del parámetro? (Implementación de MUX y Gates)

Digamos que tenemos A, B, C, que son todas representaciones de números decimales. A y C son 4bit, B es 2bit. si A es cualquiera de esos números (p. ej., 0,5,6,11), la función es    F (A, B, C) = AB + C Si A es el resto de los números...
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(Sistema) Verilog: ¿extrayendo un bus / vector más pequeño de un bus más grande?

¿Cuál es la mejor práctica para crear un bus, que es solo la extracción de ciertos bits de un bus más grande? No quiero almacenar los números de índice para realizar la búsqueda en el programa generar si se pudiera evitar ... Esperaba algo como...
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Simplificando una expresión booleana con solo puertas XOR

Tengo una expresión booleana que simplifiqué con un K-MAP. Solo quiero implementarlo con solo XOR gates, lo intenté de muchas maneras pero no pude manejarlo. ¿Es posible convertir esta expresión en la implementación de "Sólo XOR Gates" usando al...
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Digital SPST 74HC4066 y relés de lámina

Me dirijo hoy para pedir ayuda con respecto a los conmutadores SPST en comparación con Reed Relays. Para controlar una serie de líneas de señal que provienen de un sensor (del cual desafortunadamente no tengo mucha información, como por ejemp...
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Derivación del criterio de estabilidad para el PLL digital tipo 3

¿Alguien podría ayudar a derivar la siguiente expresión (4.23), que es el criterio de estabilidad para el PLL digital tipo 3? Nota: las capturas de pantalla se toman del libro de Floyd Gardner: Phaselock Techniques 3rd Edition     
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Duración del flanco ascendente de un pulso bajo a alto

En un dispositivo que estoy usando, veo lo siguiente en la descripción ... "Al inicio, el módulo requiere un impulso ON_OFF enviado desde el host. Un segundo impulso enviado desde el host volverá a entrar en el modo de hibernación. El impulso...
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Construyendo un Multiplicador de 5 bits

Actualmente estoy aprendiendo lógica digital y me han asignado la tarea de crear un multiplicador de 5 bits utilizando solo puertas simples. Lo vi recomendado aquí para usar un Tabla de verdad para ayudarte a construir el circuito. Desafortuna...
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Construye un multiplicador de 2 bits con dos complementos

Tengo que construir un multiplicador paralelo que acepte números de 2 bits en dos complementos y como entrada y salida un número de 4 bits. Ya construí el multiplicador, pero no entiendo cómo puedo implementar el complemento de dos.