Preguntas con etiqueta 'cache'

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¿Puede una CPU funcionar solo con una fuente de alimentación y una ROM, utilizando solo la memoria caché interna como RAM?

¿Puede una CPU (como la Intel i3 / i5 / i7 / Xeon) con memoria RAM en caché en el chip usarla como su única RAM funcional, sin ningún banco de memoria externo conectado? O debe que haya RAM externa, y no se puede acceder o usar el caché sol...
hecha 19.06.2017 - 16:25
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¿Por qué el caché L1 es más rápido que el caché L2?

Estoy tratando de entender por qué ciertas memorias caché de CPU son más rápidas que otras. Al comparar la memoria caché con algo como la memoria principal, existen diferencias en el tipo de memoria (SRAM vs DRAM) y problemas de localidad (en ch...
hecha 31.03.2014 - 03:47
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¿Existe una correspondencia entre el tamaño del caché y la latencia de acceso?

¿Existe una correspondencia entre los tamaños de caché y la latencia de acceso? En igualdad de condiciones, ¿un caché más grande funciona más lento? Si es así, ¿por qué? ¿Cuánto más lento?     
hecha 19.09.2013 - 14:21
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apilar caché en lugar de registros

¿Hay un procesador que realice operaciones aritméticas en una pila y no en registros? Por supuesto, para mantener el rendimiento, ese procesador debe almacenar en la caché el bloque superior de una pila en el mismo tipo de memoria que se usa par...
hecha 17.10.2012 - 02:24
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¿Cuál es el significado de esta línea? “Vista en caché, asignada en memoria, de flash QSPI externo. El caché se especifica como 32 KB con asociatividad de 4 vías ".

   Vista en caché, asignada en memoria, de flash QSPI externo. El caché se especifica como 32 KB con   Asociatividad de 4 vías. ¿Significa que mi flash QSPI externo es de solo 32Kb o que se ha asignado en memoria a 32Kb? ¿La vista en cach...
hecha 05.09.2018 - 09:07
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¿Cómo entender mejor la asociatividad del caché?

AFAIK esta definición es la más clara y física: Número de asociatividad = Número de comparadores. ¿Es correcto? ¿Podrías hacer una definición más precisa / mejor? La ilustración de wikipedia es algo difícil de ver:     
hecha 16.04.2013 - 09:33
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¿Diferencia entre cachés de 2 y 4 vías?

No entiendo completamente esta imagen: Si los cachés de datos e instrucciones están separados, ¿no significa que esta CPU no es un modelo de von Neumann sino un modelo de Harvard? ¿Y qué significa que una memoria caché es bidireccional...
hecha 06.12.2012 - 21:33
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El controlador se reinicia después de habilitar el caché

Estoy usando un controlador MCF5253 que se basa en la arquitectura Coldfire. Tiene 8KB de caché de instrucciones. Todo funcionaba bien hasta que habilité su caché de instrucciones. Ahora lo que está sucediendo es que el adaptador se está reini...
hecha 20.09.2011 - 08:29
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Procesador - interfaz de caché de datos L1

Lo siento si la siguiente pregunta parece una pregunta muy especializada (o de programación), pero espero que haya gente en este foro que haya realizado el modelado VHDL / Verilog y pueda responder: Estoy escribiendo un modelo de simulación d...
hecha 19.03.2013 - 08:18
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Clasificación de los datos de las instrucciones (ARM I-cache y D-cache)

Algunos núcleos ARM como la familia de núcleos ARM9 tienen una arquitectura de Harvard, al menos a nivel de caché. Es decir, acceden a dos cachés independientes, un caché I para instrucciones y un caché D para datos (ejemplo ARM926EJ-S). Sin...
hecha 07.11.2012 - 11:52