¿Cómo pedir prestado el tiempo en STA?

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Ahora estoy tratando de estudiar sobre el préstamo de tiempo como se refiere aquí: "Time Borrowing": Análisis de tiempo estático (STA) básico (parte 2) .

Especialmente, estoy viendo esto:

¿Cómo obtener tiempo y cómo conseguir que esto no sea una infracción de configuración?

En mi opinión, L1 a L2 necesitaban 8ns de tiempo, pero el período es de 5ns. Entonces necesita 3ns más. Pero L2 captura los datos de L1 en el reloj sensible positivo PH2. En este momento, los datos aún no han llegado (necesitaba 3ns).

No entiendo cómo decir que esto no es una violación de configuración de L1 a L4?

    
pregunta gagaga

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En el ejemplo que se muestra, hay dos relojes, el reloj normal de conducción L1, L3 y un reloj tardío de conducción L2 y L4. El último reloj debe ser 3ns después del reloj principal. Esto da 8ns requeridas para el primer camino. De L4 a L1, el lanzamiento se retrasa, la ruta agrega 2ns y la captura se realiza en el borde del reloj.

Por supuesto, el diagrama es una simplificación porque no anticipa ninguna ventana entre los límites de retención de la configuración, pero la adición de sesgo en el árbol del reloj puede compensar los problemas de retención que de otro modo podrían introducirse donde existen caminos muy cortos. La retención siempre se puede arreglar agregando lógica redundante (hasta el punto en que los diferentes puntos de operación se superponen con la configuración y se mantienen en conflicto).

En los flujos ASIC, esta optimización es una parte natural del flujo (que se realiza después del primer par de pasos). En FPGA, espero que sea menos probable que sea útil (ya que la estructura hace que las rutas muy cortas sean menos probables), y requeriría la dedicación de una red de reloj.

    
respondido por el Sean Houlihane

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