En Verilog puedo usar el mismo cable como entrada y salida para un módulo

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Esto es lo que quiero decir:

module someModule(~);
wire w;
someOtherModule m0 (.input(w), .output(w));
endmodule

¿Sería legal algo como esto?

    
pregunta Dylan A

2 respuestas

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Claro. ¿Por qué no sería? ¿De qué otra manera harías comentarios?

Por ejemplo, para hacer un cambio DFF en cada reloj, conectas la salida no-Q directamente a la entrada D.

    
respondido por el Dave Tweed
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Sí, esto es muy común. Solo asegúrate de no crear un circuito de retroalimentación combinatoria. Es decir. si output se definió en el módulo como:

assign output = ~input;

Esto crearía efectivamente un oscilador.

    
respondido por el Connor McKay

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