Parámetros de diseño del doblador de voltaje

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Buscando ayuda para responder algunas preguntas sobre la elección de parámetros para un circuito duplicador de voltaje pequeño.

Estoy buscando crear un prototipo de un generador de números aleatorios alimentado por USB basado en el ruido de disparo de un diodo Zener que acaba de entrar en su región de descomposición. Entiendo que el mejor ruido es de Zener con una ruptura de más de 5 voltios, así que creo que necesito un doblador de voltaje. Espero manejar el doblador de voltaje con la señal de un puerto GPIO en el PSOC 5LP y medir la salida usando un segundo pin. Encontré un buen artículo antiguo de 1998 un enfoque similar, pero creo que se puede hacer con Muchos menos componentes hoy.

El artículo decía: "El rendimiento de ruido óptimo se obtiene a partir de un diodo Zener 1N753A, que tiene una 'rodilla' Zener de 6.2-V". También mencionó que la corriente óptima para la salida de ruido era de aproximadamente 20 uA, generando aproximadamente 20 mV ruido de pp.

Basándome en esta idea, he esbozado este circuito

Así que mis preguntas son:

¿Tiene sentido manejar esto desde un puerto GPIO?

¿Alguna razón por la que deba intentar que la unidad se aproxime a una onda sinusoidal, o puedo golpearla con una onda cuadrada como la salida digital?

¿Hay algún límite en la frecuencia a la que debo conducir? Entiendo que las frecuencias más altas reducirán el tamaño de los capacitores que necesito.

Con una frecuencia elegida, ¿cómo dimensiono los condensadores?

P.S: Tenga en cuenta que parte del objetivo de diseño aquí es hacer que el chip SoC ajuste el voltaje "duplicado" para optimizar el ruido generado. No necesitará doblar completamente VCC.

    
pregunta Burt_Harris

2 respuestas

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Mark tiene todo lo correcto, excepto que se debe tener en cuenta que el ánodo de D3 debe estar conectado a + 5V. Luego, cuando el PWM está bajo, C4 se carga. Cuando el PWM es alto, esa carga aparece en serie con la salida de PWM, ojalá sea el doble.

Otro enfoque a considerar sería el venerable viejo 7660 o uno de sus sucesores; no agrega mucho (si acaso) a la complejidad, y usted tiene todo tipo de información de diseño en la (s) hoja (s) de datos.

    
respondido por el BobU
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No sé nada acerca de la parte de ruido Zener de su circuito, pero al usar multiplicadores de voltaje, puedo ofrecerle algo de experiencia.

El punto es cargar completamente los condensadores y luego invertir la polaridad tan pronto como estén cargados. Por lo tanto, debería dimensionar los condensadores según su voltaje y frecuencia de conmutación (si es necesario, si utiliza una frecuencia de línea de 60Hz), O seleccione su frecuencia de conmutación según su voltaje y el tamaño de los capacitores (su mejor apuesta, ya que PWM es una MCU) . Puede ver cómo se cargan los condensadores en un alcance mientras ajusta la frecuencia para optimizar el rendimiento.

Una onda cuadrada se carga más rápido que una onda sinusoidal, porque la tensión de carga se mantiene en su punto máximo. Suponiendo un ciclo de trabajo del 50%, la corriente que entregará su doblador será menos de la mitad de lo que puede proporcionar el pin PWM (porque es de media onda).

Sin embargo, no creo que su circuito esté configurado correctamente (todavía). Puedo ver los límites de carga cuando PWM es alto, pero nada cuando es bajo (asumo que PWM oscila entre Vcc y GND). Normalmente, la entrada de un doblador oscilaría tanto en positivo como en negativo, y C4 se cargaría a la polaridad opuesta cuando PWM es negativo. Esa carga se bombearía a la siguiente etapa del condensador (C1).

Una solución sería eliminar la conexión a tierra del circuito y, en cambio, conducir ese nodo con PWM / (una forma invertida de PWM). Por supuesto, entonces "sense" solo es válido cuando PWM es alto y PWM / es bajo.

BobU tiene la mejor solución: ate el ánodo de D3 a + 5v.

En la discusión que sigue, estoy ignorando las caídas de diodos. Sin embargo, cuando se opera a voltajes tan bajos, las caídas del diodo tendrían un efecto significativo en el voltaje final. Los diodos de Schottky serían apropiados.

En cuanto al tamaño del condensador, existe una relación entre el tamaño de la tapa y la frecuencia de conmutación. El pin GPIO necesita cargar el primer condensador, y asumiremos que la corriente de carga es constante, al máximo que el pin puede alimentar y hundir. Así que la energía en el condensador aumentará linealmente. Si espera hasta que esté completamente cargado antes de cambiar las polaridades (y descargue esa carga en la siguiente etapa), obtendrá el voltaje máximo ("duplicación real", ignorando la caída del diodo). La corriente disponible proviene del pin GPIO, pero dejará de fluir una vez que el condensador esté lleno. Si cambia las polaridades antes de que se llene la tapa, no obtendrá el voltaje máximo disponible. Si cambia más tarde, no obtendrá la corriente máxima disponible.

Una estimación de la corriente disponible sería:

[(GPIO max source current) + (GPIO max sink current)] / 2

Eso supondría un ciclo de trabajo del 50%. Si la corriente de fuente y de sumidero son muy diferentes, valdría la pena ajustar el ciclo de trabajo para equilibrarlos.

Aquí hay una fórmula útil:

La corriente constante de 1 mA aumenta el voltaje en un capacitor de 1 microfaradio en 1 voltio en 1 milisegundo.

Ya que tiene un límite de .02 uF y 5 voltios, entonces 1 mA cargará el límite en 100 microsegundos. Eso equivaldría a una frecuencia PWM de 5 kHz. Es probable que su frecuencia tenga que ser más rápida, ya que su pin GPIO probablemente proporciona más de 1 mA. Si duplica el tamaño de su gorra, reduciría la frecuencia a la mitad (duplicaría el tiempo de carga).

La corriente de carga real del pin GPIO no se especificará con ninguna precisión, por lo que es posible que necesite optimizar dinámicamente. Dado que tiene un pin de "detección", un enfoque sería comenzar la frecuencia de conmutación demasiado alta y observar el aumento de voltaje a medida que baja la frecuencia. Luego, dejará de disminuir la frecuencia una vez que detecte el voltaje deseado.

    
respondido por el Mark

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