¿XADC está sincronizado en Artix 7 Series FPGA?

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Me preguntaba si los datos de salida del XADC en la placa Basys 3 son síncronos.

Es decir, ¿puedo usar el indicador EOC (Fin de conversión) como reloj para otros módulos y esperar que sea una señal periódica?

Estoy en duda porque recientemente alguien me explicó que para diferentes voltajes, el XADC puede tardar más en convertirse. Pero no sé si la placa lo maneja internamente para obtener una salida sincrónica continua.

    

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Sí, es síncrono. Los procesos de seguimiento y conversión dentro del propio ADC están sincronizados con el reloj, por lo que, naturalmente, las banderas también lo son. Puede ver esto en las formas de onda de temporización en el Capítulo 5 de UG480.

Creo que no escuchaste el punto sobre diferentes voltajes. El XADC siempre puede muestrear a 1 MSPS, pero puede optar por reducir la velocidad para permitir que la señal se estabilice, ya sea reduciendo la velocidad del reloj, configurando el bit ACQ o utilizando la temporización de eventos en lugar del muestreo continuo (consulte la sección "Ajuste de Tiempo de liquidación de la adquisición "en el Capítulo 2).

UG480 - XADC Dual 12-Bit 1 MSPS Convertidor de analógico a digital

    
respondido por el jalalipop

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