Necesito convertir un montón de señales de datos de un FPGA que sale a 3.3V CMOS a 2.5V para una pantalla LCD. He encontrado el SN74CB3T16210 y el SN74AVCBH164245 y parece que ambos harán el trabajo, pero estoy preocupado por la línea del reloj. Tengo un reloj de píxeles a alrededor de 10MHz que también necesita un cambio de nivel y me preocupa que no salga limpio.
¿El reloj realmente será un problema con alguna de estas soluciones?
Cuando dices que necesitas "nivelar" la línea del reloj, ¿te refieres a una línea más para convertir entre la lógica de 3.3 V y la lógica de 2.5 V? ¿O quiere decir que necesita que esta línea tenga niveles no estándar en la salida (como V_hi = 2.5 V, V_low = 1.25 V o algo así)?
Si solo necesita convertir a niveles de 2.5 V CMOS, casi cualquier tecnología de lógica discreta que haga 2.5 V debería poder manejar relojes de 10 MHz sin ningún problema. Por ejemplo, el SN74AVCBH164245 que usted menciona especifica un retardo de propagación máximo de 3.7 ns cuando se traduce de 3.3 V (en el lado "A") a 2,5 V (en el lado "B"). Esto es menos del 5% de su período de reloj de 100 ns.
Como Gustavo señaló en los comentarios, también debe observar el tiempo de subida y bajada de sus señales. Debe resolver esto a partir de la corriente de la unidad disponible en su búfer de traducción (aproximadamente 8 mA para el '164245 a 2.5 V) y la capacidad con la que está cargado. Usted puede aproximadamente estimar
\ $ t _ {\ mathrm {edge}} = \ dfrac {\ Delta {} V} {CI} \ $
En este caso, puede tener una carga de hasta aproximadamente 16 pF, y aún así ser capaz de conducirla a una velocidad de 2.5 V en aproximadamente 5 ns, nuevamente mucho más baja que su período de reloj.
Además, para la conversión unidireccional de alto voltaje a bajo voltaje, que parece que está haciendo con su reloj, también puede utilizar un búfer de 2.5 V con entradas "3.3-V tolerantes" , por ejemplo, SN74LVC1G34 . Esta será una solución un poco más simple y, por lo tanto, probablemente más económica.
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