Generando un tren de pulsos deseado en el software Xilinx ISE

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Generando un tren de pulsos deseado en el software Xilinx ISE

#1 de Martin Thompson (1 votos)

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Necesito ayuda con VHDL y FPGA ya que soy nuevo en esto.

Tengo un Virtex-4 FPGA y deseo generar un tren de pulsos binarios de 16 pulsos de FPGA utilizando la programación VHDL. Mi tren de pulsos deseado será como "1011100111000110" (ancho de pulso mínimo = 30 ns).

Para ser muy precisos, deseo generar este tren de pulsos y enviarlo a un pin IO de FPGA para que pueda observarlo en el alcance. Además, no deseo enviar ninguna señal de entrada (como input :std_logic_vector(15 downto 0) ) excepto el reloj y la carga. Así que me pregunto si puedo escribir un código VHDL que sea sintetizable y dé el resultado deseado (con cualquier enfoque como FSM o contador o registro de desplazamiento).

fpga basic vhdl pulse shift-register

pregunta vhdlnovice

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Yo usaría un registro de desplazamiento: use constant para iniciarlo en el tren de pulsos deseado cuando se confirme el reinicio y luego descartarlo. Su entidad de nivel superior solo necesitará tres pines, reloj, reinicio y la salida.

respondido por el Martin Thompson

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