¿Por qué poner más lógica parece aumentar la frecuencia de trabajo?

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¿Por qué poner más lógica parece aumentar la frecuencia de trabajo?

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Estoy trabajando en un diseño en Xilinx Zynq. Después de la síntesis e implementación, la peor holgura negativa es aproximadamente 8.9ns, lo que significa que el circuito funciona a aproximadamente 112MHz. Sin embargo, después de agregar núcleos ILA para depurar algunas señales, el peor es el negativo. la holgura cae a 4.180ns, lo que efectivamente duplica (casi) la frecuencia de trabajo.

Creo que esto se debe a una reorganización diferente de las LUT dentro del FPGA, pero ¿podría alguien contestarme con seguridad? ¿Por qué más lógica proporciona un circuito más rápido?

fpga xilinx zynq

pregunta Arkoudinos

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Uno solo puede adivinar y usted probablemente lo adivinó correctamente.

La verdadera pregunta es ¿importa? Si estabas de acuerdo con 112Mhz, entonces no debería importar.

Cuando estaba haciendo el diseño de chips, el simulador usó la capacitancia de la pista desde una esquina de la matriz hasta la esquina opuesta para calcular el retraso del peor de los casos. Un dado más pequeño tendría demoras más cortas.

Mi conjetura es que cuando había más bienes raíces disponibles, el retraso máximo era más largo. Ahora su lógica se enrutará en un área más pequeña, por lo que los tiempos de demora serán menores.

Si es importante, pregunta a Xilinx.

También existe la posibilidad de que el ILA haya introducido algunas restricciones de tiempo relajado. El ILA se supone que debe heredar sus limitaciones de tiempo. Tal vez si no tiene ninguno, su tiempo predeterminado es restricciones definidas en el ILA.

¿Por qué poner más lógica parece aumentar la frecuencia de trabajo?

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