Verilog: datos de muestreo tanto en posición como en posición del reloj

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Tengo un flujo de entrada en serie que ha dejado los datos en posición del reloj, y los datos correctos están en el margen del reloj.

Me gustaría sincronizar y llevarlos a la posición del mismo reloj.

Podría hacerlo usando otro reloj con el doble de frecuencia.

¿Cómo sincronizar los datos usando el mismo reloj?

    
pregunta doll

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Use el margen del reloj para muestrear los datos "correctos" y almacenarlo en un registro, luego use la posición para muestrear los datos "izquierdos" y el registro. 

reg r;
always @(negedge clock) begin
    r <= right_data;
end

always @(posedge clock) begin
    // use left_data and r here
end
    
respondido por el avakar

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