Preguntas con etiqueta 'systemc'

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SystemC vs HDLs

Actualmente estoy involucrado en un proyecto universitario para implementar un procesador de un conjunto de instrucciones existente. La idea es que al final del proyecto pueda sintetizar este diseño y ejecutarlo en un FPGA. Todo va bien hasta ah...
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¿Cómo hace exactamente SystemC / SystemVerilog que la verificación sea menos laboriosa?

Hoy en día, SystemC o SystemVerilog se usan para la verificación de diseños complejos, especialmente para cosas como los diseños SoC que son realmente complejos. Sé que estos idiomas incorporan las técnicas de diseño OOP al dominio de diseño d...
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Precisión funcional y de tiempo de un modelo RTL

A veces estoy realmente confundido por el uso abusivo de la jerga en los artículos y libros de diseño de EDA / VLSI. Sin definiciones precisas, le toca al lector hacer una interpretación que es muy ambigua e incorrecta a veces Me gusta,...
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Modelado preciso de bits para algoritmos (FPGA)

¿Cuáles son las herramientas de software utilizadas en la industria para crear modelos de algoritmos de precisión de bits (algoritmos que se implementarán en FPGA)? Antes de usar una herramienta como Quartus, probamos nuestro algoritmo en le...
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Kernel de simulación de SystemC

Utilizando el siguiente código del tutorial de doulos en SystemC #include "systemc.h" #include SC_MODULE(mon) { sc_in<bool> A,B,F; sc_in<bool> Clk; void monitor() { cout << setw(10) << "Time"; cout...
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Cómo mantener el valor en el puerto hasta que se reinicie

De los experimentos en simulación, parece que la señal, una vez establecida, se mantiene en el nivel del último write , al menos en la simulación y en la salida de la forma de onda. ¿Está realmente garantizado por la especificación? Intent...
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biblioteca VHDL vs SystemC [cerrado]

Hoy aprendí sobre SystemC, una biblioteca de C ++ que facilita el desarrollo de FPGA. (para las personas que conocen C ++) Aparentemente, es tan eficiente como VHDL (hablando de rendimiento) y más rápido de aprender y codificar. ¿Desaparecerá...