mapa genérico y genérico | retraso total de tiempo para cada archivo

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En adder.vhd 

  H1: half_Adder generic map ( gate_delay => 6 ns );      
  port map ( a => ln1, b => ln2, ... );

half_adder.vhd 

  Ex1 : xor generic map ( gate_delay => gate_delay );
  A1  : and generic map ( gate_delay => gate_delay );

y.vhd 

  entity and is generic ( gate_delay : Time := 2 ns );

xor.vhd 

  entity xor is generic ( gate_delay : Time := 3 ns );

Le di cuatro archivos.

Mi pregunta es, ¿cuánto se debe esperar para ver el resultado correcto? En otras palabras, ¿cuál es el tiempo de demora total para cada archivo?

    
pregunta Martin Thompson

1 respuesta

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Dado que la ruta más larga en un medio sumador es solo una puerta, el retraso del Todo el circuito será igual al retardo de la puerta. En este caso, el retardo de puerta es de 6 ns. Los valores predeterminados para gate_delay de ambas entidades de puerta se anulan en las instancias que escribes.

Tenga en cuenta que su código no funcionará ya que and y xor son palabras reservadas en VHDL. Deberá cambiar el nombre a algo como and_gate y xor_gate

Otra nota al margen: el código VHDL como este solo se usa para el nivel de puerta simulación con anotaciones de tiempo, generalmente después de la síntesis y el lugar y la ruta. Si desea escribir un sumador en VHDL, debe escribir a <= b + c;

    
respondido por el Philippe

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