Vias en el panel central QFN en Eagle PCB

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Estoy usando algunos dispositivos QFN en una PCB que estoy diseñando usando el software Eagle PCB. Los paquetes QFN tienen una almohadilla central que está conectada a tierra y está diseñada para ayudar con la disipación térmica.

Al crear el paquete, si tengo la almohadilla central como una almohadilla real, obtengo errores de DRC cuando coloco las vías en la almohadilla para conectarla al plano de tierra en el lado opuesto de la placa.

Otra posibilidad sería dejar el teclado central fuera del paquete y dibujarlo en la pizarra, pero esta es una solución bastante insatisfactoria.

¿Cuál es la mejor manera de tratar este problema?

    
pregunta ralight

3 respuestas

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Bien, he encontrado una solución a este problema.

La respuesta es colocar la almohadilla central en el paquete con "detener" y "crema" apagados, luego dibujar manualmente rectángulos para las capas "detenerse" y "crema" sobre la almohadilla como habrían aparecido de todos modos .

El resultado final físico es el mismo, pero colocar las vías en el pad no produce errores de DRC.

    
respondido por el ralight
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Cuando creas el paquete / esquema para la parte, asigna el teclado central a un pin adicional en el símbolo del esquema y lo vincula a la señal adecuada (generalmente GND u ocasionalmente VCC).

Si no desea confundir el esquema, en la mayoría de las herramientas de diseño puede ocultar un pin y conectarlo internamente a otro pin. Así que solo debes ocultar el pin para la almohadilla central y decirle que está agrupado con un pin GND o cualquier otra señal a la que se deba acoplar.

Hacer eso debería permitirte pasar cheques de DRC. Algunas herramientas de diseño tratarán los VIA múltiples como un bucle de señal y los eliminarán, es posible que tenga que establecer una marca para la señal en particular para evitar esa comprobación. He tenido que hacer esto con Altium en el pasado, pero no creo que Eagle realice la eliminación automática de bucles, por lo que probablemente pueda omitir esto.

Si la almohadilla central es para el control térmico, debe asegurarse de que utiliza las vías suficientes para conducir el calor. En esa situación, por lo general, incluyo el número / tamaño requerido de las vías en el diseño del paquete real y solo los doy vuelta en el diseño final de la PCB si realmente lo necesito. No recuerdo la parte superior de mi cabeza si Eagle permite explotar huellas de paquetes para editar en la PCB o no.

    
respondido por el Mark
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Simplemente ponga las vías en el teclado y viva con los errores de DRC. Con el software Pulsonix que uso, puedo poner vías en las almohadillas sin errores de DRC siempre que estén asignados a la misma red. Quizás puedas hacer lo mismo con Eagle. También puedo crear almohadillas de cualquier forma con una o más vías en ellas.

    
respondido por el Leon Heller

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