Tengo una pregunta que pide dibujar un circuito para una puerta NAND con un nMOS y un pMOS. La forma en que se plantea la pregunta parece que significa solo una de cada una. Sé que puede hacer ese tipo de puerta con dos nMOS cada una para una entrada entre tierra y vdd, por lo que si ambas entradas son "1", las dos puertas están abiertas y la ruta está abierta, y he visto una versión con dos pMOS entre vdd y salida, pero no veo ninguna manera de hacerlo con solo uno de cada uno. ¿Es esto posible? ¿Estoy tomando mal el significado de la pregunta?
compuerta NAND con un pMOS y un nMOS
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pregunta windy401
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Hay implementaciones que utilizan la "lógica de transistor de paso". No regeneran los niveles lógicos, por lo que deberían mezclarse con la lógica CMOS normal.
Google ofrece varios resultados, uno de ellos:
Actualización:comoseñalaKenShirriff,estaimplementaciónmuestraunapuertaAND.AcontinuaciónsemuestraunaimplementaciónNAND,peronuevamenteserequiereninversores.
(Fuente:
respondido por el
Mario
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NAND la puerta se puede hacer con dos PMOS Y dos NMOS. Una posible implementación como se ve en la imagen.
respondido por el
netizen
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