Estoy armando un simple circuito DTACK para una máquina de fabricación casera de 68k, y parte de eso me obliga a saber cuándo se afirma que el Strobe de Datos Superior (UDS) o el Strobe de Datos Inferior (LDS) es BAJO. Solo tengo unos pocos CI aleatorios a la mano, así que estoy intentando usar un 7408 Y controlando la salida en dos entradas de una compuerta NOR 7402.
Por alguna razón, la salida de la compuerta AND aparentemente no es correcta, parece perder los pulsos y no sé por qué. Es un chip rápido y creo que estamos dentro de sus tolerancias, ¿qué debería estar buscando?
La salida a continuación de mi analizador lógico muestra 3 líneas de dirección (D0-D2), UDS & LDS (D3 & D4) y la traza desde el puente entre las dos entradas NOR (D5) (la misma señal está presente directamente en la salida del AND). Sé que las entradas no utilizadas deben estar vinculadas en BAJA o ALTA, pero supongo que es cuando una entrada no se utiliza para una puerta individual en un paquete cuádruple.