El siguiente esquema muestra un PNP BJT controlado por la salida de una puerta lógica. Cuando la salida de la puerta lógica es alta, el transistor debe estar apagado y solo debe activarse cuando la lógica se agota. El problema es que mientras la tapa está cargando, la tensión de base excede la ruptura de Vbe inversa, que es de alrededor de 5v. ¿Hay alguna solución?