Revise y pregunte sobre el circuito AD9838

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He intentado crear un esquema del uso de AD9838. Utilicé la eval. Junta esquemática y modificada a mis necesidades. La eval. El esquema de la placa se puede encontrar en la página 9 aquí:

AD9838 eval. Esquema del tablero

Y mis versiones se ven así:

Tengoalgunaspreguntasconcretas:

  1. Elcondensadormarcadoconrojonoserecomiendaenlahojadedatosynosésitienealgúnefectoimportante,exceptolareducciónderuido.¿Deboconservarloono?

  2. Elcapacitorestámarcadoconverde,nopuedomencionarloenlahojadedatosyquierosaberquéhaceysitengoqueincluirlo.

  3. Losdoscondensadoresmarcadosconazultampocosemencionanymepreguntocómoafectanlaseñal.

  4. Loscondensadoresmarcadosconamarillosupongoquesonlastapasdedesvío/desacoplamiento?

  5. Estecircuitosepuedeusarconunosciladordecristalde16MHz.SolotengoelcristalHC-49yelrecomendadoesunEpsonSMDcon3puertos.¿PuedoconectarelHC-49directamentealpinMCLKodeboagregarcomponentesadicionales(resistencia,condensadores?).Estodebeestareneláreamarcadadecolorrosa.¿Quérecomiendas?

  6. ¡Seaprecianotrascorrecciones/mejoras!

Aquíestálahojadedatosde AD9838

    
pregunta iQt

1 respuesta

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1: el condensador dentro de un círculo en rojo es opcional, por eso hay un enlace puente allí. Según la página 7 en las tablas de descripción de los pines:

"El regulador requiere un condensador de desacoplamiento de 100 nF típico, que es conectado desde CAP / 2.5V a DGND "

Por lo tanto, solo usa la tapa de 100nf.

2: COMO antes, en la tabla de función de pin página 8 el pin COMP necesita esa tapa porque: "Pin de polarización DAC. Este pin se utiliza para desacoplar la tensión de polarización DAC"

3: los dos condensadores azules en los pines IOUT generalmente no están cargados, ya que el esquema sugiere "DNI" o "DNL" significa que no se carga (no es normal tenerlo allí). Si tenía una salida principalmente de CC y hay problemas de ruido de alta frecuencia en la salida, supongo que podría ponerlos allí para obtener una salida más limpia.

4: La fuente de alimentación amarilla AVDD y DVDD son efectivamente condensadores de desacoplamiento de la fuente de alimentación. Debe colocarlos en la PCB cerca de los pines IC asociados con los rieles de suministro. C6 y C7 deben colocarse lo más cerca posible del Pin 2 del IC. C8 y C9 deben colocarse lo más cerca posible del Pin 1 del IC.

5: en el esquema de la hoja de datos al final, el que ha referenciado y bloqueado algunas partes: hay un IC de generador de reloj o un pin de entrada CLK opcional. Esto significa que el chip no tiene un controlador de cristal adecuado dentro. Por lo tanto, no puede darle un cristal con límites de carga (generalmente en el rango de 18-33pF) porque no puede conducir la señal por sí misma. Debe suministrarlo con una señal de reloj generada externamente. La descripción del Pin 5 (MCLK) es la siguiente:

"Entrada de reloj digital. Las frecuencias de salida DDS se expresan como una fracción binaria de la frecuencia de MCLK. La precisión de la frecuencia de salida y el ruido de fase están determinados por este reloj".

Así que debes darle un reloj adecuado, no un cristal (reloj de estilo analógico, supongo que podrías considerar un cristal)

6: buena suerte amigo! Seguir el esquema del tablero de evaluación es una apuesta segura. Cualquier otra pregunta, no dudes en preguntar.

    
respondido por el KyranF

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