A un capacitor electrolítico no le gusta un voltaje más alto en su terminal opuesto, es decir, un voltaje más alto solo debe estar en el terminal positivo según la convención. Si es así, cómo sobrevive el capacitor en este circuito cuando la señal de CA viaja en cualquier dirección. El capacitor debe morir en ciclo negativo. ¿Por qué no está sucediendo?
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Si realiza un análisis de señal pequeña , el capacitor ve una pequeña tensión negativa, sin embargo, en realidad está encima del sesgo, que es una tensión positiva relativamente grande (5 V o algo así). El voltaje a través de C2 nunca puede ser negativo para una carga pasiva.
Es de suponer que agregaría una resistencia de carga del colector para ver alguna salida, porque no habrá ninguna en el colector y muy poco en el emisor.
Nota: Eso es asumir condiciones "normales". Si alimenta una onda sinusoidal de 10kV 1kHz en el circuito, verá un voltaje negativo en la tapa de 100uF, pero es probable que también ocurran otras cosas malas
La corriente puede fluir dentro y fuera de un condensador electrolítico y, por lo tanto, puede considerarse como una corriente alterna, pero eso no significa que el condensador sufra una tensión inversa en sus terminales.
Supongo que está llamando la salida al cable de conexión conectado al colector de Q1.
Su salida está vinculada directamente a la fuente de 12 V, por lo que la salida es una constante de 12 V sin componente de CA.
Si arregla el circuito para permitir una salida de CA, obtendrá una salida de CA sesgada en torno a +6 V (si la diseña de manera óptima). El voltaje de salida instantáneo nunca será negativo.
El emisor de Q1 solo generará corriente (salvo algunos efectos de timbre capacitivo no deseado), por lo que C2 siempre tendrá un voltaje positivo.
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