¿Cómo pueden explicarse estos picos de voltaje negativo?

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Intenté entender el circuito de medición de capacidad. Un método básico es cargar un capacitor con una corriente constante y mostrar cuánto tiempo llevó alcanzar el 50% de voltaje, por ejemplo. Capacidad = (corriente * delta T) / voltaje

Circuito básico:

simular este circuito : esquema creado usando CircuitLab

La imagen muestra el inicio / final de la carga y la descarga a través de Q1. Después de 245 µs (después de que el voltaje del capacitor es de 0 V durante varios µs), la carga comienza nuevamente. Lo que no puedo explicar es el repentino pico de voltaje negativo cuando el transistor de carga está apagado (245µs).

¿Alguien puede explicar eso? ¿Podría esto solo ser un problema de simulación (LTSpice)?

Reemplazéeltransistorconun"interruptor controlado por voltaje" (SW) y no hubo ningún pico en absoluto.

La fuente actual es una fuente de corriente de 2 transistores (1.5µA).

    
pregunta bkausbk

1 respuesta

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El pico negativo no se debe a la inductancia: cuando ocurre, C1 simplemente se carga a un voltaje negativo, después de lo cual la fuente de corriente lo carga con una corriente positiva, y el voltaje aumenta.

Apostaré a que el transistor de la fuente actual es un PMOS (o un PNP) que tiene capacidad de compuerta de drenaje (o colector-base).

La activación de este transistor ENCENDIDO se realiza al bajar la compuerta / base unos pocos voltios.

Esto pierde algo de carga a través de la capacitancia de la compuerta de drenaje.

Dado que C1 tiene un valor muy bajo, una pequeña capacidad de pF en la PMOS o PNP será suficiente para cambiar su voltaje.

Este circuito no mide C1: mide la suma de las capacitancias de C1, la fuente de corriente, la capacitancia de entrada del comparador, la capacitancia del colector de Q1, etc. ¡No se puede ayudar! ...

Por el mismo motivo, al activar Q1 en fugas, se carga un poco a través de su Cbc, lo que explica el pico positivo al final de la carga.

    
respondido por el peufeu

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