¿Hay un monitor de bus gratuito / de bajo costo en VHDL / Verilog para los protocolos ARM AXI / AXI4 y / o AXI4-Stream?

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Estoy buscando algo para registrar las lecturas y escrituras en un bus AXI 4 en un archivo. Y similar para AXI4-Stream. Por lo que vale, esto es para Xilinx. Podría rodar la mía, pero esperaba que alguien más hubiera resuelto este problema.

    
pregunta Brian Carlton

1 respuesta

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¿Ayuda el modelo funcional de Xilinx AXI Bus?

enlace tiene un enlace a Resumen del producto AXI BFM

    
respondido por el Martin Thompson

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