Problema en la demodulación FSK

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Tengo una señal modulada FSK de datos binarios. Estoy tratando de recuperar esto usando PLL.

Las frecuencias de marca y espacio están en el rango de 1.5 MHz a 7 MHz.

Estoy luchando porque, la salida de PLL no es estable, en el sentido de que la señal varía como una onda sinusoidal y esto dificulta el proceso de decisión (porque no puedo fijar el umbral como "0" o algo así) otro valor).

Aquí está la salida LPF de PLL:

Séquenopuedousarestodirectamenteparalatomadedecisiones,asíqueestoyusandounfiltroequirippledepasobajodespuésdelPLL,quedaunaseñalbastantebuenaquepuedousarparatomardecisiones.Peronuevamente,elproblemaesquelaseñalvaríacomounaondasinusoidalynounavariaciónhorizontaladecuada,queesloqueestoybuscando.

AquíescómolasalidaLPFes:

Todoloquequieroesque,paramantenerelcentrodelaseñal"0" en todo momento instantáneo. ¿Cómo puedo lograr eso con Simulink?

Aquí están los parámetros de bloque, PLL:

Filter: [1]/[1   2*pi*0.001]
VCO input sensitivity: 5 Hz/V
VCO Quiescent frequency: 10000 Hz
VCO initial Phase: 0
VCO output amplitude: 10V

Nota importante: estoy buscando demodulación a diferentes velocidades de datos, por lo que quiero variar el tiempo de muestra en el generador binario de Bernoulli de 1 a 0.00001 i, e de 1bps a 100kbps. Lo que he observado aquí es que a medida que la velocidad de datos cambia, la propiedad de la salida del filtro PLL cambia y eso me permite reajustar el PLL por cada cambio significativo en este tiempo de muestra (o como lo he denominado velocidad de datos). Para esto, si alguien me puede dar consejos o soluciones para demodular la señal a cada ritmo sin volver a ajustar el PLL, será de mucha ayuda.

    

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Bueno, si puede estabilizar el PLL un poco más, esto proporcionará una mejor recuperación cuando se trata de recuperar los datos, pero, en ausencia de cualquier mejora, podría intentar pasar la señal a través de un filtro de paso alto. que tiene un corte cerca de la frecuencia de la velocidad de datos.

Debería eliminar la oscilación ascendente y descendente de baja frecuencia (en gran medida), pero tenderá a convertir sus datos en bordes como este: -

Y,pararecuperarlos"datos diferenciados, puede usar un comparador con histéresis significativa o usar dos umbrales (a cada lado de 0 voltios) que configuran y restablecen un flip-flop. Incluso puede filtrar con paso bajo la señal de datos para hacer una señal que tiende a seguir las ondulaciones (que viene por el PLL) y la usa para modificar los umbrales para contrarrestar cualquier ondulación que quede después del filtrado de paso alto.

Tuve que hacer casi lo mismo en un trabajo en el que estuve involucrado y me sentí muy feliz con los resultados. La cantidad de ondulación superpuesta a la señal era muy similar a su ejemplo, pero ciertamente comenzaría por mejorar el PLL porque cualquier ganancia en la eliminación de la ondulación no deseada facilita la vida en el circuito de detección (segmentador de datos).

Después de la edición en la pregunta, tengo un par de observaciones sobre los parámetros de PLL: -

  • Creo que su frecuencia de reposo VCO debería ser de aproximadamente 3 MHz y no de 1 Hz.
  • Dado que la salida de PLL es de hasta 10 voltios, creo que la sensibilidad del VCO está bien a 1 MHz por voltio, siempre que realice la frecuencia central (inactiva) como sugerí.
  

Lo que he observado aquí es que a medida que cambia la velocidad de datos, la   propiedad de los cambios de salida del filtro PLL y que me hace   reajuste el PLL para cada cambio significativo en este tiempo de muestra

Cuando su velocidad de datos se ralentiza y se dirige hacia la frecuencia de paso bajo del filtro de bucle PLL, es posible que tenga problemas que dependen de su aplicación. Algunas aplicaciones permiten que el PLL VCO rastree la frecuencia modulada (un filtro de bucle rápido), mientras que otros diseños querrán mantener el VCO aproximadamente a la mitad entre las dos frecuencias FSK (filtro de bucle lento). No está claro cuál es su diseño.

    
respondido por el Andy aka

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