Una duda con respecto a VHDL [cerrado]

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He hecho dos multiplicadores, digamos Védico y Védico Modificado. Ahora, el retraso combinacional de Vedic es 49ns y el de Vedic modificado es 44ns. Quiero usarlos para la multiplicación en el algoritmo DWT.

Ahora, cuando uso el multiplicador védico para la multiplicación en el algoritmo DWT, el retardo de la ruta crítica es de 115 ns. Por otro lado, cuando uso el multiplicador védico modificado para la multiplicación en el algoritmo DWT, el retardo de ruta crítico del diseño es de 125 ns.

Ahora mi pregunta es: el retardo de ruta crítica de védico es mayor que el de védica modificada, mientras que DWT que usa el multiplicador védico tiene un retardo de ruta crítica menor que el de DWT que usa védica modificada. ¿Es posible?

Por favor, ayúdame con esto.

    
pregunta Krupa

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