No estoy seguro si esto pertenece aquí.
Utilizando FPGA:
Digamos que recibo una entrada de activación para mi sistema.
Quiero declarar que una ventaja es parte de mi señal si la obtengo cada vez que X \ $ \ mu \ $ s. (digamos 1 \ $ \ mu \ $ s)
4 disparadores en X \ $ \ mu \ $ s el tiempo es suficiente para que salga OK.
Más específico: digamos que x es la línea de tiempo y es un disparador que obtengo. El disparador podría ser una señal válida que recibo o puede ser ruido. Digamos que se ven igual. La única forma en que puedo reconocer una señal de entrada válida es detectándola 4 veces separadas por 1 \ $ \ mu \ $ s. La entrada podría ser cualquier cosa: 1