¿Alternativa a la duplicación de conversiones de binario a BCD en FPGA?

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Quiero diseñar un convertidor de binario a BCD. Si bien el algoritmo de dabble doble es fácil, también tarda mucho tiempo en ejecutarse porque no puede hacer todo el cálculo en paralelo.

¿Hay alternativas al doble dabble que tampoco requieran multiplicación / división?

Estoy buscando un algoritmo genérico que pueda funcionar en cualquier tamaño.

    
pregunta gilianzz

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